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[主观题]

74148的逻辑符号和功能表分别如图10.42(a)和表10.5(a)所示,74138的逻辑符号和功能表分别如图10

74148的逻辑符号和功能表分别如图10.42（a)和表10.5（a)所示,74138的逻辑符号和功能表分别如图10

.42(b)和表10.5(b)所示.试用1片二进制优先编码器74148、1片二进制译码器74138和少量与门设计一个8-3格雷码编码器.要求写出设计过程,画出电路图(3位二进制码A₂A₁A₀和对应格雷码B₂B₁B₀之间的关系为B₂=A₂其他 74148的逻辑符号和功能表分别如图10.42（a)和表10.5（a)所示,74138的逻辑符号和功 ).

74148的逻辑符号和功能表分别如图10.42（a)和表10.5（a)所示,74138的逻辑符号和功

74148的逻辑符号和功能表分别如图10.42（a)和表10.5（a)所示,74138的逻辑符号和功

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第1题

已知TTL集成施密特触发器CT74132和同步4位二进制加法计数器CT74161组成如图6.13所示电路;图6.1

4为CT74132的电压传输特性曲线(CT74161的功能表在此从略,可查阅).

(1)分别指出图6.13中两部分电路组成什么功能的电路(名称).

(2)分析CT74161组成的电路,画出状态转换图.

(3)试画出u_A、u_B、u_C(CO为进位输出端)的对应波形.

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第2题

已知一位二进制全加器逻辑符号如图10.52(a)所示,进位输出表达式C_o=G+P·C_i(其中G=A_i⌘

已知一位二进制全加器逻辑符号如图10.52（a)所示,进位输出表达式C_o=G+P·C_i（其中G=A_{i⌘已知一位二进制全加器逻辑符号如图10.52(a)所示,进位输出表达式C_o=G+P·C_i(其
中G=A_i·B_i,P=A_i+B_i),试求采用超前进位结构的三位二进制加法器(如图10.52(b)所示)的最高位进位输出表达式C_o3.}

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第3题

用二-十进制优先编码器74LS147和同步十进制计数器74LS160及其他必要的器件组成可控分频器,当

输入控制信号A、B、C、D、E、F、G、H分别为低电时,输出脉冲与时钟脉冲的分频比分别为1/9、1/8、1/7、1/6、1/5、14、1/3、1/2.请画出电路图.74LS147逻辑符号如图5.30(a)所示,74LS160逻辑符号如图5.30(b)所示,74LS160功能如表5.5所示,Q₃、Q₂、Q₁、Q₀为输出端,Q₃、Q₂、Q₁、Q₀为置数数据输入端:CO为进位输出,在计数至1001时输出一个时钟周期的高电平.

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第4题

设计一个多功能组合逻辑电路,M₁、M₀为多功能选择输入信号,a、b为逻辑变量,F为电路的输出

,当M₁M₀取不同值时,电路具有不同的逻辑功能如表3.9所示.试用八选一数据选择器和最少的与非门实现,规定M₁、M₀及a分别接选择器的A₂A₁A₀如图3.8所示.

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第5题

一种简单的D锁存器晶体管级电路如图题5.3.2所示，试列出该电路的功能表。这种电路广泛用于CMOS静

态随机存储器(SRAM)中作为基本存储单元。

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第6题

若信号波形和电路结构仍如图3-16所示,波形参数为T=5μs,T=10μs.(1)适当设计电路参数,能否分别

若信号波形和电路结构仍如图3-16所示,波形参数为T=5μs,T=10μs.（1)适当设计电路参数,能否分别

若信号波形和电路结构仍如图3-16所示,波形参数为T=5μs,T=10μs.

(1)适当设计电路参数,能否分别从矩形波中选出以下频率分量的正弦信号:50kHz,100kHz,150kHz,200kHz,300kHz,400kHz？

(2)对于那些不能选出的频率成分,试分别利用其他电路(示意表明)获得所需频率分量的信号(需用到电路、模拟电路、数字电路等课程的综合知识,可行方案可能不止一种).

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第7题

写出如图10.15所示电路的最简逻辑表达式,并说明其逻辑功能.

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第8题

移位寄存器的逻辑结构图如图3.6（a)所示,CLK和D₀的输入波形如图3.6（b)所示.设Q初始状态为0,

移位寄存器的逻辑结构图如图3.6(a)所示,CLK和D₀的输入波形如图3.6(b)所示.设Q初始状态为0,画出Q₃~Q₀的波形.

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第9题

八选一数据选择器组成电路如图10.1所示,该电路实现的逻辑函数是Y=().

八选一数据选择器组成电路如图10.1所示,该电路实现的逻辑函数是Y=（).

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第10题

组合逻辑电路及输入波形(A，B)如图题4.1.2所示，试写出输出端的逻辑表达式并画出输出波形。

组合逻辑电路及输入波形（A，B)如图题4.1.2所示，试写出输出端的逻辑表达式并画出输出波形。

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