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[主观题]

维持一阻塞D触发器及其输入时钟脉冲CP及D信号波形分别如图4.13(a)、(b)所示,设触发器的初态为0,

维持一阻塞D触发器及其输入时钟脉冲CP及D信号波形分别如图4.13(a)、(b)所示,设触发器的初态为0,试对应画出Q端的输出波形.

维持一阻塞D触发器及其输入时钟脉冲CP及D信号波形分别如图4.13(a)、(b)所示,设触发器的初态

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第1题
维持阻塞D触发器接成图题13-5(a)、(b)、(c)、(d)所示形式,设触发器的初始状态为0,试根据图(c)所示

维持阻塞D触发器接成图题13-5(a)、(b)、(c)、(d)所示形式,设触发器的初始状态为0,试根据图(c)所示的CP波形画出Qa,Qb,Qc,Qd的波形。

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第2题
画出图P5.14(a)中两个JK触发器FF1和FF2的输出端Q1和Q2的电压波形。时钟脉冲CLK、
画出图P5.14(a)中两个JK触发器FF1和FF2的输出端Q1和Q2的电压波形。时钟脉冲CLK、

异步置零端R´D和输入端J、K的电压波形如图P5.14(b)所示。设触发器的初始状态均为Q=0。

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第3题
画出图P5.6(a)中脉冲触发SR触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入S、R的电压波形如
画出图P5.6(a)中脉冲触发SR触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入S、R的电压波形如

图P5.6(b)所示。设触发器的初始状态为Q=0。

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第4题
为避免主从JK触发器的一次变化问题,故在CP=1期间应确保J,K的输入状态保持不变。()
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第5题
逻辑线路如图10.81所示,当连续输入7个正CP脉冲时,画出Q1、Q2、Q3和F的对应波形.(各
逻辑线路如图10.81所示,当连续输入7个正CP脉冲时,画出Q1、Q2、Q3和F的对应波形.(各

触发器起始均为0态)

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第6题
已知下降沿有效的边沿JK触发器CP、J、K及异步置1端 、异步置0端的波形如图10.3所示,试画出Q的波形

已知下降沿有效的边沿JK触发器CP、J、K及异步置1端、异步置0端的波形如图10.3所示,试画出Q的波形(设Q的初态为0).

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第7题
基本的R£­S触发器两个输入端R=1、S=1,输出端Q=()。

A.维持原状态

B.1

C.0

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第8题
要使J—K触发器在时钟脉冲作用下的次态与现态相反,J—K的取值应为()。

A.00

B.11

C.01

D.10

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第9题
由时钟脉冲控制的所有触发器同时翻转的计数器叫做()。
由时钟脉冲控制的所有触发器同时翻转的计数器叫做()。

A、同步计数器

B、异步计数器

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第10题
钟控RS触发器的触发时刻为()

A.CP=1期间

B.CP=0期间

C.CP上升沿

D.CP下降沿

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