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[主观题]

1.用8K*8的RAM存储器芯片,构成32K*8的存储器,存储器的起始地址为18000H,要求各存储器芯片的地址连续,用74LS138作译码器,系统中只用到了地址总线的A18~A0,采用部分译码法设计译码器电路。试画出硬件连线图,并列表说明每块芯片的地址范围。

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第1题
8K×8的RAM芯片的地址引脚条数是()条

A.10

B.11

C.12

D.13

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第2题
MCU(MicroControllerUnit)微控制器阶段的技术发展路线是()。

A.将CPU、存储器(RAM和ROM)、多种I/O接口等集成在一片芯片上,形成芯片级计算机

B.包含了数字处理的全部功能,接入部分外围附加芯片,即构成完整的微型计算机

C.满足嵌入式系统所要求的各种外围电路与接口电路

D.对嵌入式系统进行智能化控制

E.不断扩展满足嵌入式应用

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第3题
已知SRAM6264芯片存储器容量是8K×8,6264的芯片引脚中有地址/数据线()条。

A.(13,1)

B.(10,8)

C.(8,8)

D.(13,8)

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第4题
对于一个有16根地址总线的微处理器系统中,采用8K*1位存储芯片形成64KB存储器,试给出每个芯片的地址范围。

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第5题
要扩展为8K×8的RAM,需要几片512×4的RAM?

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第6题
下列半导体存储器中,基于FLASH芯片的是()。

A.RAM

B.DRAM

C.SRAM

D.RAMNon-volatile

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第7题
下面有关ROM和RAM的叙述中,错误的是()。

A.RAM是可读可写存储器,ROM是只读存储器

B.ROM和RAM都采用随机访问方式进行读写

C.系统的主存由RAM和ROM组成

D.系统的主存都用DRAM芯片实现

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第8题
设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高
设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高

电平为读,低电平为写)。现有下列存储芯片:1K×4位RAM,4K×8位RAM,2K×8位ROM,以及74138译码器和各种门电路,如图所示。画出CPU与存储器连接图,要求:1.主存地址空间分配:8000H~87FFH为系统程序区;8800H~8BFFH为用户程序区。

2.合理选用上述存储芯片,说明各选几片?

3.详细画出存储芯片的片选逻辑。

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第9题
下列4条叙述中,正确的一条是()。

A.为协调CPU与RAM间速度差,在CPU芯片中集成了高速缓存

B.PC机在使用过程中突然断电,SRAM中存储的信息不会丢失

C.PC机在使用过程中突然断电,DRAM中存储的信息不会丢失

D.CPU可以直接处理外存储器中的信息

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第10题
在以8088CPU构成的系统中,设计一容量为8Kx8b的RAM,起始地址空间(无地址重叠)为8000H,提供的芯
在以8088CPU构成的系统中,设计一容量为8Kx8b的RAM,起始地址空间(无地址重叠)为8000H,提供的芯

片为:74LS138、SRAM6264,请完成下列两个任务:

(1)简要说明设计工作原理。

(2)补全下图中全译码片选法的电路,可适当添加所需电路或芯片。

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