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题目内容（请给出正确答案）

[单选题]

某SRAM存储芯片的数据线宽度为32bit，地址线宽度为24bit，则该芯片的存储容量为（)。

A.16MB

B.32MB

C.64MB

D.128MB

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第1题

SRAM芯片容量512K位（bit)，有4条数据线，则它具有的地址线条数为（)

A.15

B.16

C.17

D.18

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第2题

若位容量为32K位的SRAM芯片具有8条数据线，则它具有的地址线条数为（）。

A.14

B.130

C.11

D.12

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第3题

设CPU共有16根地址线，8根数据线，并用MREQ作访存控制信号(低电平有效)，用WR作读写控制信号(高

设CPU共有16根地址线，8根数据线，并用MREQ作访存控制信号（低电平有效)，用WR作读写控制信号（高

电平为读，低电平为写)。现有下列存储芯片：1K×4位RAM，4K×8位RAM，2K×8位ROM，以及74138译码器和各种门电路，如图所示。画出CPU与存储器连接图，要求：1.主存地址空间分配：8000H～87FFH为系统程序区;8800H～8BFFH为用户程序区。

2.合理选用上述存储芯片，说明各选几片？

3.详细画出存储芯片的片选逻辑。

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第4题

用2K×4位/片的存储芯片组成容量为8K×8位的存储器，地址总线A15～A0(低)。双向数据总线D7～D0(低)

用2K×4位/片的存储芯片组成容量为8K×8位的存储器，地址总线A15～A0（低)。双向数据总线D7～D0（低)

,读/写信号线R/W。请回答：

1、画出该存储芯片级逻辑图，包括地址总线、数据线、片选信号线(低电平有效)及读/写信号线的连接。

2、将地址总线A15～A0中的哪几位分配给存储芯片,并写出各片选信号的逻辑式，即

CS0=？CS1=？CS2=？CS3=

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第5题

假定某PC机I/O总线的带宽是250MB/s,数据线宽度32位,在每个时钟周期内传输2次数据,该总线的频率大约是（)MHz。

A.31.25

B.62.5

C.125

D.250

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第6题

若某微处理器系统有16条地址线，字长为8位，现用SRAM2114（1K*4)存储芯片搭建存储子系统，试问采用线选译码时最多可以扩展（)片2114存储芯片。

A.12

B.20

C.24

D.32

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第7题

某SRAM芯片,其容量为1024×4位,则地址和数据引脚的数目分别为（)。

A.10,4

B.5,4

C.10,8

D.5,8

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第8题

某SRAM芯片容量为1M×8位，除电源和接地端外，控制端有E和WE，该芯片的管脚引出线数目是（)。

A.20

B.28

C.30

D.32

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第9题

某存储器具有8根地址线和8根双向数据线,则该存储器的容量为().

某存储器具有8根地址线和8根双向数据线,则该存储器的容量为（).

A.8x3b

B.8Kx8b

C.256x8b

D.256x256b

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第10题

某存储器芯片有14根地址线,8根数据线,它的容量大小是（)KB。

A.14

B.16

C.32

D.64

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