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[单选题]

基本的R-S触发器,禁止输入端R、S输入。()

A.R=1,S=1

B.R=0S=1

C.R=0S=0

D.R=1S=0

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第1题
基本的R£­S触发器两个输入端R=1、S=1,输出端Q=()。

A.维持原状态

B.1

C.0

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第2题
在时序逻辑电路中,R£­S触发器是由()组成,Q是()输出端,Q是()输出端,R是()输入端,S是()输入端。
在时序逻辑电路中,R£­S触发器是由()组成,Q是()输出端,Q是()输出端,R是()输入端,S是()输入端。

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第3题
若主从结构SR触发器的CLK、S、R、R'D</sub>各输入端的电压波形如图P5.9所示,S'D=1试画出Q、Q

若主从结构SR触发器的CLK、S、R、R'D各输入端的电压波形如图P5.9所示,S'D=1试画出Q、Q'端对应的电压波形.

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第4题
画出图P5.6(a)中脉冲触发SR触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入S、R的电压波形如
画出图P5.6(a)中脉冲触发SR触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入S、R的电压波形如

图P5.6(b)所示。设触发器的初始状态为Q=0。

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第5题
画出图P5.14(a)中两个JK触发器FF1和FF2的输出端Q1和Q2的电压波形。时钟脉冲CLK、
画出图P5.14(a)中两个JK触发器FF1和FF2的输出端Q1和Q2的电压波形。时钟脉冲CLK、

异步置零端R´D和输入端J、K的电压波形如图P5.14(b)所示。设触发器的初始状态均为Q=0。

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第6题
画出图P5.1(a)中SR锁存器Q和Q'端的电压波形。输入端S和R的电压波形如图P5.1(b)所示。

画出图P5.1(a)中SR锁存器Q和Q'端的电压波形。输入端S和R的电压波形如图P5.1(b)所示。

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第7题
D触发器有()触发信号输入端。

A.四个

B.一个

C.二个

D.三个

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第8题
触发器的输入端加上信号后,触发器的输出状态要由<1>();<2>();<3>()等几个因素来决定。
触发器的输入端加上信号后,触发器的输出状态要由<1>();<2>();<3>()等几个因素来决定。

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第9题
‎触发器的SD、RD输入端一定要使用无抖动开关。SD、RD输入端为直接置位端、直接复位端,微小的抖动也会引起输出端状态改变。()‎
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第10题
如果计数器的计数脉冲不是同时加到所有触发器的计数输入端,而只加到最低位触发器的计数输入端,其他各级触发器则由相邻的低位触发器来触发,这时计数器称为()。

A.同步计数器

B.异步计数器

C.可逆数器

D.步计数器

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