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用PAL16R4设计一个4位的双向移位寄存器。(注:本书末尾的附页2是PAL16R4的逻辑图,可作为习题纸使用。)

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第1题
用PAL16R4设计一个4位的格雷码计数器(参见上题注)。

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第2题
设计一个4位奇偶校验器,当4位数中有奇数个1时,输出为0,否则输出为1。要求进行逻辑功能分析(真值表、逻辑表达式),基本逻辑门用VHDL语言设计描述,并进行功能仿真。
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第3题
用PAL16L8设计一个代码转换电路,将输人的BCD代码转换为输出的4位格雷码。两种代码的对照表见本书第1章表1.2.1和表1.2.2(参见上题注)。

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第4题
用2K×4位/片的存储芯片组成容量为8K×8位的存储器,地址总线A15~A0(低)。双向数据总线D7~D0(低)
用2K×4位/片的存储芯片组成容量为8K×8位的存储器,地址总线A15~A0(低)。双向数据总线D7~D0(低)

,读/写信号线R/W。请回答:

1、画出该存储芯片级逻辑图,包括地址总线、数据线、片选信号线(低电平有效)及读/写信号线的连接。

2、将地址总线A15~A0中的哪几位分配给存储芯片,并写出各片选信号的逻辑式,即

CS0=?CS1=?CS2=?CS3=

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第5题
试分析图P8.5给出的用PAL16R4构成的时序逻辑电路,写出电路的驱动方程、状态方程、输出方程,画出
电路的状态转换图.工作时,11脚接低电平.

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第6题
用PALl6R4设计一个4位二进制可控计数器.要求在控制信号M1M0=11时作加法计数;在M1M
0=10时为预置数状态(时钟信号到达时将输入数据D3、D2、D1、D0并行置人4个触发器中);M1M0=01时为保持状态(时钟信号到达时所有的触发器保持状态不变);M1M0=00时为复位状态(时钟信号到达时所有的触发器同时被置1).此外,还应给出进位输出信号.PALI6R4的电路图见图P8.5.

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第7题
试用一片4位数值比较器74LS85和一片4位二进制加法器74LS283设计一个4位二进制数到8421 BCD码的转换电路。

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第8题
设计一个代码转换电路,要求输入为4位自然二进制码,输出为4位循环码。根据题意,符合设计要求的逻辑函数表达式和逻辑电路是()。

A.(1)和(3)

B.(1)和(4)

C.(2)和(3)

D.(2)和(4)

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第9题
设计一个数据处理电路,输入数据A和B各为4位二进制数。当A>B时,要求给出A>B的信号和A-B的数值;当A<B时,要求给出A<B的信号和B-A的数值。

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第10题
目前寄修为双向自费()
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