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[主观题]
逻辑线路如图10.81所示,当连续输入7个正CP脉冲时,画出Q1、Q2、Q3和F的对应波形.(各
逻辑线路如图10.81所示,当连续输入7个正CP脉冲时,画出Q1、Q2、Q3和F的对应波形.(各
触发器起始均为0态)
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触发器起始均为0态)
示.试用时域方法求:
(1)该系统的单位阶跃响应s(T),并大概画出s(t)的波形;
(2)在系统输入为图2-16所示的x1(1)时的输出信号y1(t),并概画出y1(t)的波形.
移位寄存器的逻辑结构图如图3.6(a)所示,CLK和D0的输入波形如图3.6(b)所示.设Q初始状态为0,画出Q3~Q0的波形.
逻辑功能,并分别用基本逻辑门电路、四选一MUX数据选择器(如图10.91(b))和3-8译码器(如图10.91(c))实现此逻辑电路.
端的电压波形如图P5,19(b)中所示。设触发器的初始状态为Q=0。
4时,v0等于多少? (2)求图b输出电压v0表达式,当R1=R2=R3时,v0等于多少?