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[主观题]

已知下降沿有效的边沿JK触发器CP、J、K及异步置1端、异步置0端的波形如图10.3所示,试画出Q的波形

已知下降沿有效的边沿JK触发器CP、J、K及异步置1端已知下降沿有效的边沿JK触发器CP、J、K及异步置1端、异步置0端的波形如图10.3所示,试画出Q 、异步置0端的波形如图10.3所示,试画出Q的波形(设Q的初态为0).

已知下降沿有效的边沿JK触发器CP、J、K及异步置1端、异步置0端的波形如图10.3所示,试画出Q

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第1题

在负边沿触发的JK触发器中J=K=0，初态为0，CP脉冲作用后触发器下一个状态为（)

A.0

B.1

C.翻转

D.不定

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第2题

从型JK触发器的从触发器开启时刻在CP下降沿到来时。（)

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第3题

由JK触发器转换成的T触发器，它的输出状态是在CP脉冲的（）时变化。

A.高电平

B.低电平

C.上升沿到来

D.下降沿到来

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第4题

试用边沿JK触发器设计一个时序逻辑电路,要求该电路的输出Z与CP之间的关系应满足图P5.7所示的波

形图.

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第5题

主从JK触发器的初始状态为0，当J=K=1，CP=1时，Q=1。（)

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第6题

对于JK触发器，若J=K=1，则CP作用后，Qn+1=（)。

A.1

B.0

C.Qn

D.Qn-

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第7题

为避免主从JK触发器的一次变化问题，故在CP=1期间应确保J，K的输入状态保持不变。（)

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第8题

沿JK触发器的（)信号不允许有冒险现象。

A.J,K

B.CLK

C./sd

D./Rd

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第9题

试用下降沿触发的JK触发器设计一个状态转换图如图5.10所示的异步计数电路.

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第10题

钟控RS触发器的触发时刻为（)

A.CP=1期间

B.CP=0期间

C.CP上升沿

D.CP下降沿

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