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[主观题]

为了使CPU不至因为等待存储器读写操作的完成而无事可做,可以采取哪些加速CPU和存储器之间有效传输的特殊措施?

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第1题
假定主存地址空间大小为1024MB,按字节编址,每次读写操作最多可以一次存取32位。不考虑其他因素,则存储器地址寄存器MAR和存储器数据寄存器MDR的位数至SHAO应分别为()。

A.30,8

B.30,32

C.28,8

D.28,32

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第2题
设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高
设CPU共有16根地址线,8根数据线,并用MREQ作访存控制信号(低电平有效),用WR作读写控制信号(高

电平为读,低电平为写)。现有下列存储芯片:1K×4位RAM,4K×8位RAM,2K×8位ROM,以及74138译码器和各种门电路,如图所示。画出CPU与存储器连接图,要求:1.主存地址空间分配:8000H~87FFH为系统程序区;8800H~8BFFH为用户程序区。

2.合理选用上述存储芯片,说明各选几片?

3.详细画出存储芯片的片选逻辑。

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第3题
在科研中,以下哪种做法是正确的:

A.为了使数据更有力地支持研究结论,在研究中出现反常数据时可以不记录。

B.遇到相互矛盾的数据时,可以运用直觉舍弃部分数据。

C.在研究中,不应瞒报互相矛盾的数据。

D.应该允许科研人员因为一时疏忽大意而在实验操作步骤、样品处理、数据记录等方面出现失误

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第4题
8086CPU存储器可寻址1MB的空间,对I/O进行读写操作时,20位地址中只有()有效。

A.高16位

B.低16位

C.高8位

D.低8位

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第5题
ARM架构可以实现对存储器中多个连续数据的读写操作,其批量加载指令LDM和批量存储指令STM仅支持()位数据。

A.8

B.16

C.32

D.64

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第6题
试用一个具有片选使能、输出使能、读写控制容量为8Kx8位的SRAM芯片和必要的逻辑门,设计一个16K×1

试用一个具有片选使能、输出使能、读写控制容量为8Kx8位的SRAM芯片和必要的逻辑门,设计一个16K×16位的存储器系统,试画出其逻辑图

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第7题
网络存储器上的数据是不排外的,同一个逻辑区域可以被多个服务器读取和修改;SAN上的数据是放在LUN上的,同一个区域需要LockManager来控制,不允许同时读写。()
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第8题
外存储器直接参与计算机的运算,它存放CPU当前不使用的程序和数据。()
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第9题
在安装CPU风扇之前,为了使风扇固定,要在CPU上涂上大量的硅胶()
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第10题
早期的Unix操作系统,有提供虚拟存储器,为了使容量有限的内存能支持较大的规模的程序,系统除采
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第11题
闪速存储器是().

A.非易失性的

B.只读存储器

C.读写存储器

D.易失性的

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